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Proposition de Thèses, Post-Doc et Stages dans l'équipe Ctsys - Grenoble INP - LCIS2
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Proposition de Thèses, Post-Doc et Stages dans l'équipe Ctsys
Propositions de Post-Doc
ou CDD
Postes ATER section 27, 61, 63
Enseignement à Grenoble INP Esisar (Valence)
Contact Recherche CTSYS :
ioannis.parissis@grenoble-inp.fr
T
hèses, post-docs, postes d'ingénieur R&D
(PhD/Post-docs/R&D positions)
PhD_position_on_FPGA_emulation_of_laser_attacks
(starting Oct. 2012) - closed
PhD position on Synchronous Testing for Embedded Software
(starting Oct. 2012) - closed
PhD position on Embedded Services Design
(starting Oct. 2012) - closed
R&D engineer position on embedded software development and testing
(starting Sep. 2012) - closed
Stages (Internships)
Verilog-AMS/VHDL-AMS modeling of laser fault attacks into analog IPs
Vérification et Analyse de Robustesse de SoC ou SoPC
(
Verification and Robustness Analysis of SOC and SoPC
)
Développement d'un middleware RFID intégrant des services de test et de diagnostic
Mise en œuvre d'une attaque par canaux de test et proposition de contre-mesures au niveau RTL
(
Set-up of scan based attacks and RT level countermeasures evaluation
)
Contacts
Ioannis Parissis
Tél : +33 4 75 75 94 46
Fax : +33 4 75 75 94 50
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Crédits
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50, rue Barthélémy de Laffemas
BP54 26902 VALENCE Cedex 09
France
Tél : +33 (0)4 75 75 94 49
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